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cpu-architecture
cpu-architecture专题提供cpu-architecture的最新资讯内容,帮你更好的了解cpu-architecture。
具有相同指令集架构 (ISA) 的 2 个 CPU 之间的类比
我们有 2 个具有此属性的 CPU- <ol> <li>时钟频率</li> <li>每次安装费用</li> <li>执行时间</li> <li>没有说明<
作者:佚名 时间:2022-05-26
读取当前非核心频率并设置非核心频率乘数
我正在开展一个项目,该项目需要在 Intel Skylake Xeon Gold 6126 服务器 CPU 上读取和设置 Uncore 频率(我需要
作者:佚名 时间:2022-05-26
数据总线和内存单元寻址混淆
我有一个关于(RAM)内存单元的问题: 对于 cpu 架构 x32, 我们将有 32 位大小的 cpu 寄存器,以及
作者:佚名 时间:2022-05-26
如何确保 C 多线程程序从主内存中读取最新值?
<a href="https://i.stack.imgur.com/SavWg.png" rel="nofollow noreferrer"><img src="https://i.stack.imgur.com/SavWg.png" alt="enter image d
作者:佚名 时间:2022-05-26
通用处理器和 HPC 处理器之间的主要区别是什么?
通用处理器和 HPC 处理器之间的主要区别是什么?我指的是影响我的程序性能的 CPU 组织部分,例如内存
作者:佚名 时间:2022-05-26
累加器 - 同时读取和写入
我有一个关于累加器的非常愚蠢的问题,我读到它通常是由 D-Flip-Flops 和 ALU 组成的。 我不明白累加器如
作者:佚名 时间:2022-05-26
当 L1 访问延迟较高时,用于有用工作的处理器周期较少
我在具有两种不同配置的处理器模拟器上运行基准程序。 Config 1 有 L1 访问延迟(hitDelay 和 missDelay
作者:佚名 时间:2022-05-26
为什么 NOP作为 5th uop会加速 Ice Lake 上的 4 uop 循环?
所有基准测试都在:<strong>Icelake:Intel(R) Core(TM) i7-1065G7 CPU @ 1.30GHz</strong> (<a href="https://ark.intel.com/content/w
作者:佚名 时间:2022-05-26
确定 12 位指令微处理器的最大内存大小、最大唯一操作数和无符号常量的最大值
我是计算机体系结构的新手,在回答这个问题时遇到了一些麻烦: 具有 12 位指令的假设微处理器由三个
作者:佚名 时间:2022-05-25
Aarch64 什么是延迟转发?
<a href="https://developer.arm.com/documentation/swog466751/a/" rel="noreferrer">"Arm Neoverse E1 Core Software Optimization Guide
作者:佚名 时间:2022-05-25
如何在 PIC18F26K22 上为多个 ADC 输入通道设置功能?
我使用 PIC18f26k22 来简单地读取两个电位计(连接到模拟引脚 AN0 和 AN1)。使用单个锅很容易,但是不止
作者:佚名 时间:2022-05-25
弱 ISA 如何使用存储缓冲区解决 WAW 内存危害? 我的猜测;我不熟悉任何实际设计的细节
现代 CPU 使用存储缓冲区来延迟提交到缓存直到退役,同时避免 WAR 和 WAW <em>内存</em> 危害。我想知道弱
作者:佚名 时间:2022-05-25
像 x86 这样的指令集会更新吗?如果是这样,如何保证向后兼容性?
旧处理器如何知道如何解码它不知道的新指令?
作者:佚名 时间:2022-05-25
如何在程序集中使用数组元素之间的对齐
下午好,我有一个关于汇编程序中数组的问题,因为我有一个包含五个元素的半字数组,我需要将它们
作者:佚名 时间:2022-05-25
MMU 如何知道操作系统使用的页表级别?
Afaik,在 x86 中,操作系统所做的只是设置 CR3 寄存器,让 MMU 做左边的工作,将线性 addr 转换为物理 addr
作者:佚名 时间:2022-05-25
研究 movdir64b 指令延迟的微基准测试
我想在支持此指令的系统上研究指令 <code>movdir64b</code> 的延迟。 如何编写一个简单的微基准来实现
作者:佚名 时间:2022-05-25
典型的 DRAM 行缓冲区大小是多少?如何找到它?
如何以编程方式或使用 *nix 系统中现有的工具找到 DRAM 行缓冲区大小?
作者:佚名 时间:2022-05-25
编译为 x86 时检测 OS x86 或 x64
我开发了引导软件来启动我的游戏。我用 Go 做到了这一点。跨平台对我来说尤其重要。另外,我不想将
作者:佚名 时间:2022-05-25
用于立即加载的 MIPS 管道阶段
我知道 MIPS 中的指令有 5 个标准阶段。对于下面的伪指令 <pre><code>li $t1, 0 # pseudo-instruction for addi $
作者:佚名 时间:2022-05-25
Linux 在内存模式下如何处理 Intel 的 Optane 持久内存模块?
我想知道当底层系统在内存模式下使用持久内存模块(近内存 DRAM 缓存和 NVRAM 作为主内存)时,Linux 内
作者:佚名 时间:2022-05-24
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