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cpu-architecture
cpu-architecture专题提供cpu-architecture的最新资讯内容,帮你更好的了解cpu-architecture。
每个核心上是否“存在”AVX/AVX2? AMD 推土机系列,成对的内核共享一个 SIMD/FP 单元和缓存
那么,这个 AVX 的东西 - 它就像每个核心的小型机器?或者它就像一个引擎单元用于整个 CPU? 比如
作者:佚名 时间:2022-05-24
运行代码时如何获取内存总线上写访问所花费的时钟周期?
假设我们有一个代码在具有 128 KB 直接映射的计算机系统上运行 块大小为 64 字节的数据缓存。系统使用
作者:佚名 时间:2022-05-24
时钟周期和 R 型命令执行次数
时钟周期需要多长时间,在 ns 中执行 R 型命令 ADD $1, $2, $3 需要多长时间: 单周期数据路径
作者:佚名 时间:2022-05-24
当取指周期因指令而异时,如何知道控制信号?
如果每条指令的第一个周期都不相同(即并非所有指令都有相同的取指周期),那么处理器如何知道第
作者:佚名 时间:2022-05-24
Cache Locality - TLB、Cache Lines 和 ...?
根据我的理解,产生“缓存局部性”高级概念的结构如下: <ol> <li>用于虚拟内存翻译的翻译后备缓
作者:佚名 时间:2022-05-24
多周期数据路径中固定的 RegWrite 控制信号的影响?
<img src="https://i.stack.imgur.com/l2PVq.png" alt="enter image description here"/> 在这个多周期数据路径中:
作者:佚名 时间:2022-05-23
如何找出 CPU 中禁用的内核?
我需要找出 CPU 上禁用了哪些内核。我怎样才能用 C/C++ 方式做到这一点?我知道读取 CAPID6 寄存器是其中
作者:佚名 时间:2022-05-23
在流水线中以相同的时钟周期读取和写入寄存器组这种情况下会不会存在数据风险?
我正在通过 David A. Patterson 和 John L. Hennessy 合着的“Computer Organization and Design, The Hardware Software Interface ARM
作者:佚名 时间:2022-05-23
了解较长代码执行速度提高 4 倍的微架构原因AMD Zen 2 架构
我在 x64 模式下使用 VS 2019(版本 16.8.6)编译了以下 C++17 代码: <pre class="lang-cpp prettyprint-override"><code
作者:佚名 时间:2022-05-23
RISC管道对设置断点的影响?
在 <a href="https://www.d.umn.edu/%7Egshute/arch/pipelining.xhtml" rel="nofollow noreferrer">RISC Pipelining</a> 指令中坚持 5 个
作者:佚名 时间:2022-05-23
将 Java while 循环转换为 ARM 程序集?
我想将一些计算来自以下循环的总和的 Java 代码转换为 ARM 程序集,我想知道:我如何才能修复到目前为
作者:佚名 时间:2022-05-22
为什么 ARM LSL 与 LSR 的允许偏移值范围不同?
为什么LSL的允许移位值为[0, 31],LSR的允许移位值为[1, 32]? 在 LSL 中移位 0 位对任何应用程序有何
作者:佚名 时间:2022-05-22
Interlocked.CompareExchange 也应该是一个可变变量吗?
以下示例来自 <a href="https://docs.microsoft.com/en-us/dotnet/api/system.threading.interlocked.compareexchange?view=net-5.0#System_
作者:佚名 时间:2022-05-22
寄存器是算术计算操作数的唯一来源吗?
(1) 我想知道寄存器是不是唯一可以进行算术计算的地方? 看起来像: <code>add BYTE PTR [var], 10 — add 10 to t
作者:佚名 时间:2022-05-22
带有 N 位加法器的 LEGv8 扩展
如果我们扩展 legv8 设计以添加 N 位比较器以从给定数组中找到数字的最小值/最大值,是否比必须通过减
作者:佚名 时间:2022-05-22
处理器加速计算差异
我想了解为什么阿姆达尔定律不适用于这种情况? 假设我们有两个配置 配置 1 的 L1 访问延迟
作者:佚名 时间:2022-05-22
如何测量 i-cache
有人告诉我,对于这样的代码,使用不需要的 REX 会浪费一个字节的 I-cache 占用空间: <pre><code>231:
作者:佚名 时间:2022-05-22
页表和缓存
据我所知,页表将存储虚拟地址、驻留位及其相应的物理地址。鉴于CPU缓存,L1,L2,L3等将数据从主存
作者:佚名 时间:2022-05-21
CPU 如何知道它需要开始执行新线程的上下文?
如果您假设一个线程正在 CPU 上执行并且随之而来的中断是可编程定时器中断。所以我的理解是 CPU 停止
作者:佚名 时间:2022-05-21
一个门输入与其他门的多个输出之间的连接如何导致电路记忆?
我正在阅读大卫·哈里斯和莎拉·哈里斯的 <a href="https://rads.stackoverflow.com/amzn/click/com/0123944244" rel="nofollow
作者:佚名 时间:2022-05-21
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