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vivado
vivado专题提供vivado的最新资讯内容,帮你更好的了解vivado。
使用 C# 重定向从批处理文件调用的可执行文件的输入和输出
<strong>我正在努力实现的目标:</strong> 一个简单的 c# 类,用于向 Xilinx Vivado 应用程序发送和接收 TC
作者:佚名 时间:2022-05-15
VHDL-来回七段计数器
我正在做一项大学作业,代码是从旧板上给出的,我不得不在新板上运行它。 (Nexys --> Basys3)。在其中
作者:佚名 时间:2022-05-15
Vivado VHDL 宽度不匹配 - 我该如何解决?
请考虑这个非常简单的最小可重现代码: <pre><code>library IEEE; use IEEE.STD_LOGIC_1164.ALL; entity test is gene
作者:佚名 时间:2022-05-14
vitis 2020.2:打开的 HLS 项目被禁用
我几乎安装了 Vitis 2020.2,当我在构建项目后尝试打开 HLS 时,它在硬件和软件仿真中都被禁用。我已经
作者:佚名 时间:2022-05-14
Verilog if 语句不一致
我正在尝试使用推送/弹出信号编写一个深度为 8 的简单 4 位堆栈,但它的行为方式非常奇怪。我的一个
作者:佚名 时间:2022-05-14
当下一状态组合逻辑块转换中的“当前状态”值时,系统 Verilog FSM“下一状态”不会转换 - 三元运算符
在我的 Verilog 代码中,<code>ns</code> 值没有分配给 <code>next state logic</code> 中的任何值。当我对 <code>next sta
作者:佚名 时间:2022-05-14
在 VHDL 中添加单个位
我一直在尝试编写一个添加单个位的组合电路。当我模拟我的代码时,我从我的临时寄存器中获取了未
作者:佚名 时间:2022-05-12
petalinux-package 无法在 /tmp
我正在关注 <a href="https://youtu.be/TR2g6pAKRT0?t=487" rel="nofollow noreferrer">this</a> 相当不错的 YT 教程,以在艺术
作者:佚名 时间:2022-05-12
SystemVerilog:在接口数组上折叠和 & ......折叠或 |在接口数组上 但是,我的问题是,如何在接口数组中的单个位字段上执行此操作尝试 #1:尝试 #2:尝试 #3:尝试 #4:尝试 #5:尝试 #6:尝试 #7愚蠢但需要哈哈:尝试 #8 bash/sh 中的一些语法,使用 @ 来引用整个数组愚蠢但需要哈哈:
我正在尝试彻底改变我的一些代码。在我在模块端口签名中使用广泛使用的结构的任何地方,我都想用
作者:佚名 时间:2022-05-11
如何在 Vivado 中启用缩进指南?
我正在使用 Vivado 2019.2 进行一些 Verilog 编程。但是,我希望显示缩进指南,因为代码块可能会变得非常
作者:佚名 时间:2022-05-11
初始化 VHDL 数组元素
几乎没有使用 VHDL 和 Vivado 的经验,所以即使是最简单的东西也想学习。 我正在制作一个如下所示的 VHDL
作者:佚名 时间:2022-05-11
从视频流保存图像 - 从 PCAM 和 zedboard 接口
我正在关注 ZedBoard FMC Pcam 适配器一到四摄像头演示 (<a href="https://reference.digilentinc.com/learn/programmable-logic/
作者:佚名 时间:2022-05-08
大多数设备无法与 WebPack 一起使用
我在我的新 PC 上安装了 Vivado 2020.3。据我所知,即使存在产品限制,我也可以将几乎所有小型 FPGA 与 WebP
作者:佚名 时间:2022-05-09
将两个 AXI 阵列映射到 Xilinx FPGA 上的同一个 DDR 存储器
我正在使用 Vivado HLS 开发 IP,该 IP 需要能够在同一 IP 的两个副本之间共享内存。 IP 需要在 ZedBoard 上运
作者:佚名 时间:2022-05-04
错误:[VRFC 10-3353] 正式端口“i0”没有实际或默认值
我正在使用以下测试平台、代码和组件制作一个简单的 2 位比较器。 我在运行模拟时不断出错 错
作者:佚名 时间:2022-05-03
vivado中的modelsim仿真
嗨,我在 Vivado 的模拟中遇到了问题。我有一个名为 ProceduralAssignment.v 的 Verilog 文件和一个名为 run.do 的
作者:佚名 时间:2022-05-03
在没有连接到 Xilinx SDK 的 FPGA 板的情况下发送 HTTP 请求
我能否在没有连接硬件的情况下从 <em><strong>Xilinx SDK</strong></em>(软件开发套件)发送 <strong>HTTP 请求</str
作者:佚名 时间:2022-05-02
传递带有向量的文件时,如何在测试平台中使用枚举?
基本上我在一个包中声明了一个 typedef 枚举(在一个名为 Definition.sv 的文件中): <pre><code>typedef enum
作者:佚名 时间:2022-05-01
在 Zedboard 上连接 OV7670 摄像头
所以我创建了这个项目,在我的 Zedboard 上通过 VGA 显示来自摄像机 OV7670 的视频,仅使用 PL 部分,合成
作者:佚名 时间:2022-05-01
Webpack Vivado 2020.2 是否包含 SDK
我很困惑。 Vivado 2021.2 是否包含使用 Webpack 许可的 SDK? Digilent 说是:<a href="https://reference.digilentinc
作者:佚名 时间:2022-04-30
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